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分岐予測が失敗して無駄になった時間は、パイプラインのフェッチステージから実行ステージまでの段数に等しい。最近のマイクロプロセッサではパイプラインは非常に長く、分岐予測が失敗した場合の遅延は10から20クロックサイクルとなる。パイプラインが長くなるほど、分岐予測の精度が要求されるようになる。
1:09 PM
CPU自体がパイプライン化されているから
1:09 PM
1クロックあたりの性能ってもうよくわからなくなってて
1:09 PM
スペックとかは統計的な話だったはず